반도체 회로설계 취준기

Recent

4th SSA: AI, AI Semiconductor (1) _ AI 기술의 현재, 미래

2025.02.24~2025.02.25 2일간 한양대학교에서 진행된 Smart Semiconductor Academy에 참석하여 인공지능과 인공지능 반도체에 대한 강의를 들었습니다. 이번 포스팅에서는 이 강연에 대해 정리하며, 추가적으로 학습한 내용을 정리합니다. 포스팅 내용 중 오류가 있다면 댓글로 남겨주시길 바랍니다!AI 기술의 현재, 미래이동수 네이버 이사님이동수 네이버 이사님께서 진행해주신 강연의 주요 내용은 AI 기술의 역사적 흐름과 LLM의 확장, AI 아키텍쳐의 변화 등을 담고 있었습니다. 딥러닝 혁명 2012년, AlexNet이 이미지넷 대회에서 압도적인 성능으로 우승을 차지하며 딥러닝 시대를 개막했습니다. 이전까지 AI는 컴퓨터 비전, 자연어 처리 등 각 분야에 특화된 서로 다른 모델을..

반도체 시사 2025.02.26 0

1. Sum - Of - Products(SOP) 형태 Sum - Of - Products(SOP): 곱의 합 형태(AND 연산된 항들을 OR연산을 통해 표현) SOP 예시 Products - Of - Sums(POS): 합의 곱 형태(OR 연산된 항들을 AND연산을 통해 표현) POS 예시 2. 논리회로의 단순화 논리회로의 단순화: 전파지연을 줄여 회로의 동작속도 향상 Boolean algebra와 Karnaugh mapping을 통해 단순화 가능 단순화 예시 3. 대수적 단순화(Algebraic Simplification) DeMorgan의 정리를 이용하여 원래의 표현식을 SOP형식으로 표현 SOP형식에서 공통인수를 찾아내어 1개 이상의 항을 소거 Algebraic Simplification 예시 4..

디지털 논리회로 2024.04.07 4

Chap 02. 진수 변환 / BCD 코드 / Gray 코드

1. 2진수 - 10진수 변환 2진수 -> 10진수 변환 : 오른쪽부터 2^0, 2^1, 2^2, ... 순으로 각 자릿수의 숫자와 곱하여 변환 예시) - 1 0011(2)인 이진수 -> 2^4 * 1 + 2^3 * 0 + 2^2 * 0 + 2^1 * 1 + 2^0 * 1 = 16 + 2 + 1 = 19(10) - 1011 0101(2) -> 2^7 + 2^5 + 2^4 + 2^2 + 2^0 = 128 + 32 + 16+ 4 + 1 = 181(10) 10진수 -> 2진수 변환: 10진수를 2로 나누며 나머지를 구하여 2진수로 변환 2. 16진수: 2진수의 4비트씩 묶어 0~9, A(10)~F(15)의 16자리로 표현 [16진수, 10진수, 2진수의 관계] 16진수 -> 10진수 변환: 2진수 -> 10진..

디지털 논리회로 2024.03.23 4

하만(Harman) 세미콘 아카데미 18일차 - Verilog HDL 설계(Clock과 Reset, 카운터 설계, 테스트벤치, 검증)

[2024.04.01.월] 인천인력개발원 하만 세미콘 아카데미 Verilog를 이용한 RTL 시스템 반도체 설계 Clock과 Reset Clock(clk, 클록) 디지털 시스템에서 데이터 처리의 타이밍을 제어하는 주기적인 신호 주파수, 주기를 통해 신호의 반복속도, 시간 등을 나타냄 Reset(rst) 디지털 시스템을 초기 상태로 되돌리는 데 사용 Synchronous Reset: 클록 신호에 동기화되어 작동 - 리셋 시 다음 클록 엣지에서 시스템 초기화 Asynchronous Reset: 클록 신호와 무관하게 즉시 작동 - 빠른 리셋이 가능하지만 동기화 문제 발생 가능 Flip-Flop(FF) 한 비트의 이진 정보를 저장하는 메모리 단위 클록 신호에 의해 제어 입력 데이터를 기반으로 두 가지 안정된 상..

Verilog를 이용한 RTL 시스템 반도체 설계 2024.04.01 23

[KLA] CSE 인턴 지원 후기_최종탈락

오늘은 KLA 인턴전형 후기를 남겨보겠습니다!면접전형에서 최종 탈락했지만 각 전형 진행 방식이나 결과 발표 등 정보 공유하고자 합니다.채용 프로세스 [결과 발표일 포함] 1. 지원서 접수 [ 2024.11.11(월)~2024.11.24(일) ]2. 서류전형 결과 발표 [ 2024.11.28 (목) ]3. 온라인 인적성 검사 실시 [ ~2024.12.01(일) ]4. 전화영어 테스트 [ 2024.12.02(월) ]5. 인적성/전화영어 결과 발표 [ 2024.12.09(월) ]6. 면접 진행 [ 2024.12.12(목) ]7. 최종 발표 [ 2024.12.20(금) ] 작년 11월 24일까지 모집한 2025 KLA 동계인턴 CS Engineer 인턴십에 지원했습니다. 이전까지는 10명 이상 선발했는데 이번 ..

취업준비 2025.01.16 6

자습시간

more

Pmod OLED 공룡 게임 만들기(3) - 최종

크롬 공룡 게임 구현 저번 게시글에 이어 마지막으로 Pmod KYPD와 Pmod OLED를 이용해 하드웨어 파일을 생성한 후, Vitis를 이용해 키패드로 동작하는 공룡 게임을 최종 완료했습니다. Vivado Process Vivado와 Vitis를 이용한 Pmod OLED 제어 [Pmod IP 이용]이번 게시글에서는 Digilent의 게시물과 IP 라이브러리를 통해 Pmod OLED의 데모 파일 구현을 진행합니다. 추후 이를 응용하여 Pmod OLED를 통해 다양한 기능을 구현할 예정입니다. Vivado, Vitis 이용방법semicon-circuit.tistory.com 이 게시글에서와 동일한 방법으로 Vivado Library에서 IP를 추가한 뒤, Pmod KYPD와 Pmod OLED를 추가하여 ..

Verilog 2025.02.20 0

Pmod OLED 공룡 게임 만들기(2)

이번에는 저번에 구현했던 비트맵에서 더 나아가 여러가지 이미지를 번갈아가며 화면에 나타내어 움직이는 듯한 모습을 구현하고자 합니다.저번에 사용했던 툴을 이용해서 공룡이 달리는 듯한 두 이미지를 생성하고, 이를 배열로 변환한 뒤 다음과 같이 코드를 작성해서 공룡이 뛰는 모션을 구현했습니다.더보기void Dino_Run() { OLED_ClearBuffer(&myDevice); OLED_MoveTo(&myDevice, 0, 0); // (0,0)에서 출력 시작 OLED_Update(&myDevice); // OLED 화면 업데이트 u8 *pat; char c; xil_printf("print dinosaur and cactus"); c = 1; while(1){ xil_pr..

Verilog 2025.02.17 0

Pmod OLED 공룡 게임 만들기(1) - 비트맵 이미지 구현

Vivado와 Vitis를 이용한 Pmod OLED 제어 [Pmod IP 이용]이번 게시글에서는 Digilent의 게시물과 IP 라이브러리를 통해 Pmod OLED의 데모 파일 구현을 진행합니다. 추후 이를 응용하여 Pmod OLED를 통해 다양한 기능을 구현할 예정입니다. Vivado, Vitis 이용방법semicon-circuit.tistory.com 지난 게시글에서 Vivado에서 Pmod IP를 이용해 하드웨어 파일을 만들고, Vitis로 Pmod OLED 데모 파일을 실행하는 과정까지 포스팅했습니다,이번 게시글에서는 이어서 직접 비트맵 파일을 Pmod OLED에 표시해보는 작업을 진행합니다. 앞으로 이 디스플레이를 이용해 구글의 공룡게임을 구현할 예정입니다. 먼저 공룡의 모습과 선인장을 픽셀로 ..

Verilog 2025.02.17 0

Vivado와 Vitis를 이용한 Pmod OLED 제어 [Pmod IP 이용]

이번 게시글에서는 Digilent의 게시물과 IP 라이브러리를 통해 Pmod OLED의 데모 파일 구현을 진행합니다. 추후 이를 응용하여 Pmod OLED를 통해 다양한 기능을 구현할 예정입니다. Vivado, Vitis 이용방법 Getting Started with Vivado and Vitis for Baremetal Software Projects - Digilent Reference digilent.com준비사항Vivado, Vitis 2023.2버전: 기존에 사용하던 2024.2버전으로는 호환이 되지 않아 해당 버전으로 수행했습니다.Digilent 보드 파일 다운로드아래의 파일을 다운로드 받아 압축을 해제한 뒤,\vivado-boards-master\vivado-boards-master\new\..

Verilog 2025.02.14 0

취업준비